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CV stage de fin d’étude - Recherche et développement | |
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Formation
2007 – 2008 Master 2 EEA Systèmes Microélectroniques, LIRMM Montpellier.
2006 – 2007 Master 1 EEA Systèmes Automatiques et Electroniques Intégrés, Univ. Montpellier 2.
2004 – 2006 Licence Electronique Electrotechnique Automatique, Université Montpellier 2.
2001 – 2004 DEUG Sciences et Technologies pour l’Ingénieur, Génie de Systèmes.
2000 – 2001 Baccalauréat Sciences Expérimentales, Lycée Omar El Khayyâm, Taza, Maroc.
Stages & Projets
Avril-Juin 2007 Stage au LIRMM
Laboratoire d’informatique, Robotique et de microélectronique de Montpellier)
« Sûreté de Fonctionnement des Implants pour Stimulation Électrique Fonctionnelle »
Mars 2007 Projet au LEM (Laboratoire d’électronique de Montpellier)
« Commande d’un moteur synchrone Brushless pour vélo électrique »
Gain : autonomie, algorithme et programmation de la commande en VHDL, et initiation aux techniques d’implantation sur FPGA.
Avril-Juin 2004 Projet au LIRMM
« Réalisation d’un modulateur - démodulateur AM avec mode de transmission par câble » Gain : autonomie, esprit d’initiative, maîtrise des appareils de mesures.
Janvier-Juin 2005 Projet à l’Université Montpellier II
« Recherche bibliographique sur les radars, et étude du principe du fonctionnement d’un radar détecteur de vitesse » Gain : autonomie.
Février-Juin 2002 Projet à l’Université Montpellier II
« Recherche et compréhension du principe de la modulation et de la démodulation d’amplitude » Gain : travail de groupe et coordination, prise de confiance à l’oral.
Acquis théoriques
Microélectronique
Test de systèmes intégrés digitaux et mixtes.
Synthèse logique et physique de circuits numériques.
Conception de systèmes numériques, circuits mixtes et hétérogènes.
Principes et architecture des circuits FPGA.
Traitement du signal, Réseaux
Théorie de l'information
Hyperfréquences et Applications
Compétences
Programmation Langages C & C++, VHDL, VERILOG.
Outils CAO CADENCE, SYNOPSYS, ISE 9.2
Simulation électrique HSpice & Pspice.
Instrumentation LABVIEW, Analyseurs de spectre, générateurs de signaux.
Test TETRAMAX (Initiation aux outils ATPG et simulation de fautes,Initiation au testeur Verigy 93K).
Langues
Français Bilingue
Anglais Lu et écrit
Arabe angue maternelle
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| Recherche d'Emploi : | Recherche de Stage | |
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| Formation : | Bac+5 | |
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| Expérience : | 0 à 2 ans | |
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| Résidence : | Hérault (34) | |
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| Préférences Géographiques : |
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| Mots Clefs : | stage de fin d'étude, master 2 EEA, C, C++, micro électronique,synopsys,cadence, test, conception, design, caractérisation, RF, RFID, systèmes intégrés digitaux et mixtes, FPGA, ATPG, | |
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